AMD Zen6 架构细节曝光

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AMD 本周发布了一份名为“AMD Family 1Ah Model 50h-57h处理器性能监控计数器”（由 InstLatX64 发现）的文档。该文档通过性能监控接口揭示了 AMD 基于 Zen 6 架构 CPU 的大量架构细节，其中包括代号为 “Venice” 的数据中心级 EPYC 处理器。事实证明，Zen 6 并不完全是 Zen 5 的进化版本，而是一个采用了全新理念的彻底重新设计。

长期以来，AMD 对 Zen 6 架构的描述一直比较笼统，仅透露其将拥有高达 256 个核心，并采用台积电的 2nm 级工艺制造。而本周这份面向软件开发者的 PMC（性能监控计数器）文档指出，Zen 6 微架构不再是 Zen 4/Zen 5 的渐进式演进，而是一种有意为之的宽口径、面向吞吐量的设计，具备八槽发射引擎（eight-slot dispatch engine）和同步多线程（SMT）技术。

在这样的设计中，两个硬件线程会动态争夺共享的发射槽资源。因此，在相同主频下，Zen 6 处理器的单线程性能在某些情况下可能不及苹果 9 宽（或更宽）的 CPU。然而，在特定场景下，这种架构有望释放极高的性能。此外，该核心还拥有针对“未使用发射槽”、“后端停顿（backend stalls）”和“线程选择损失”的专用计数器，这证实了 “宽发射（wide issue）”和 “SMT 仲裁”是 AMD 在 Zen 6 上押注的核心方向。

Zen 6 还显著增强了 AMD 对矢量和浮点执行的可视性，凸显了该架构对密集数学计算工作负载的重视。根据 PMC 文档：

• Zen 6 处理器支持 FP64、FP32、FP16 和 BF16 数据格式的全宽 AVX-512 执行。

• 支持包括 FMA/MAC 操作以及混合 FP-INT 矢量执行（涵盖 VNNI 类、AES 和 SHA 操作）。

• 其持续的 512 位吞吐量极高，以至于需要“合并性能计数器”才能进行准确测量。

虽然这并不能直接证明 Zen 6 将成为 AVX-512 的性能冠军，但它确实表明 Zen 6 每个周期可以完成数量惊人的矢量工作，甚至超出了传统测量方法的承载范围。

总的来说，Zen 6 这些专注于性能的特性表明，它是 AMD 首个完全从零开始、专为数据中心场景设计的微架构。目前尚不清楚哪些特性会被保留在消费级（客户端）产品中，以及它们的表现如何。但就目前观察到的信息来看，基于 Zen 6 的 CPU 将会是不折不扣的“算力怪兽”。

https://www.tomshardware.com/pc-components/cpus/amd-pubs-first-zen-6-document-for-developers-a-brand-new-8-wide-cpu-core-with-strong-vector-capabilities

（来源：tom‘shardware）

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